・2022/06/25
ファミコン、スーパーファミコンのゲーム コントローラの信号線の通信仕様のまとめ
(NES、SNESのコントローラの信号の仕様、4021、W545、V520、V520B、シフトレジスタ)
Tags: [FPGA], [電子工作], [Xilinx XC6SLX9], [FPGA 2022]
● ファミコン、スーパーファミコンのゲーム コントローラの信号線の通信仕様のまとめ
NES、SNESのコントローラの信号の仕様、4021、W545、V520、V520B、シフトレジスタ。
下記の FPGAでファミコンを動かす、では本物のファミコンのコントローラを使用しています。
なのでファミコンのコントローラの通信仕様を調べてみました。
・2022/06/25
FPGA Spartan-6 XC6SLX16でファミコンを動かす!
Xilinx FPGA Spartan-6 XC6SLX16 NES clone in ALINX AX309
ちなみに MSX等の D-SUB 9pinのジョイスティックの信号は単純に各 pinにボタンの配線がしてあるだけです。
通称 MSX仕様 ジョイスティック
1 UP
2 DOWN
3 LEFT
4 RIGHT
5 (+5V)
6 A
7 B
8 GND
9 (NC)
● NES
コントローラの内部には 4021と言う汎用のシフトレジスタが使われています。
全部で 8bit長で各ボタンの状態を送信します。
ボタンの状態は負論理(Lowで押した状態)です。
CD4021BE
MN4021B MNは松下
MC14021B MCはモトローラ
TC4021BP TCは東芝
CD4021B-Q1 CMOS 8-Stage Static Shift Register datasheet
白 +5V
オレンジ LATCH(P/S)
赤 CLOCK
茶 GND
黄 DATA
LATCH _|~~~|_____________________________________________________________________
CLOCK ~~~~~~~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~~~
DATA -| A | B |SELECT | START | UP | DOWN | LEFT | RIGHT |-----
DATA
High = None
Low = Pushed
・ Player 1
4016H bit 0 Set
4016H bit 0 Reset
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
4016H Read bit 0
CPUからの bitの読み値は Highと Lowが逆転しています。
0 = None
1 = Pushed
・ Player 2
4017H bit 0 Set
4017H bit 0 Reset
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
4017H Read bit 0
・ Player 2 Mic
4016H Read bit 2
● SNES
コントローラの内部には W545や V520と言うミツミ製のシフトレジスタが使われています。
全部で 16bit長で、最後の 4bitは機器 IDとなっています。
ボタンの状態は負論理(Lowで押した状態)です。
初期型、W545 12pin 2個使用
中期型、V520 20pin
後期型、V520B 20pin
白 +5V
黄 CLOCK
オレンジ LATCH(P/S)
赤 DATA
茶 GND
16.67ms = 1/60 sec
LATCH _|~~~|______________________________________________________________________________________________________________________________________
CLOCK ~~~~~~~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~|___|~~~~~~
DATA -| B | Y |SELECT | START | UP | DOWN | LEFT | RIGHT | A | X | Top-L | Top-R | ID(H) | ID(H) | ID(H) | ID(H) |------
DATA
High = None
Low = Pushed
SHVC-005 ID=HHHH
Tags: [FPGA], [電子工作], [Xilinx XC6SLX9], [FPGA 2022]
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